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STI（Shallow Trench Isolation，浅沟槽隔离）逐渐取代 LOCOS（Local Oxidation of Silicon，局部氧化硅） 工艺，主要是因为它更适应现代集成电路（尤其是深亚微米及纳米技术节点）的需求。下面从多个方面详细解释为什么 STI 能取代 LOCOS。
一、技术演进背景
1970 年提出了 LOCOS 工艺，即“硅的局部氧化”技术（Local Oxidation of Silicon），用来隔离器件。随着集成电路向更小的工艺节点发展（从 0.5μm 逐渐进入 0.35μm、0.18μm、90nm 乃至更先进的节点），器件密度大大提升，对隔离技术提出了更高要求。
二、LOCOS 工艺的缺陷
- 鸟嘴效应（Bird’s Beak）
如下图，LOCOS 工艺中，氧气在氮化硅掩膜下横向扩散形成“鸟嘴”，导致隔离区实际宽度比设计宽，浪费芯片面积，限制了器件的集成度。
- 隔离宽度大，不适合高密度集成
由于鸟嘴效应和热氧化的扩散特性，LOCOS 难以实现亚微米甚至纳米级的窄隔离区，导致芯片面积不能有效缩小。
- 隔离深度受限
LOCOS 形成的氧化层在深度和形状上难以精确控制，导致隔离性能受限，特别是在 SOI 或高电压器件中难以抑制漏电或晶体管击穿。
- 热预算高，不利于工艺控制
LOCOS 需要高温长时间热氧化，会引起扩散工艺的不可控性，增加晶体缺陷（如应力导致的穿晶缺陷）。
三、STI 工艺的优势
- 高密度集成能力强
STI 通过浅沟槽结构实现隔离，边界清晰，无鸟嘴结构，隔离区可以做到很窄（<0.2μm），非常适合纳米尺度工艺。
- 良好的电隔离性能
STI 的氧化物填充可以实现深而窄的隔离结构，有效防止漏电、晶体管间耦合及 Latch-up 等问题。
- 工艺兼容性强
STI 使用的工艺流程（刻蚀、沉积、CMP）更适合现代 CMOS 工艺中普遍采用的多层互连和高 - k 金属栅技术。
- 形貌控制好
STI 通过化学机械抛光（CMP）获得较平整的晶圆表面，有利于后续光刻和多层布线。
- 低热预算，更适应先进工艺
STI 主要是沉积与刻蚀过程，减少了高温氧化对晶圆结构的干扰，有利于先进工艺中多种材料的协同使用。
四、实际应用趋势
| 工艺节点 | 主流隔离技术 |
|---|---|
| >0.5μm | LOCOS |
| 0.35μm ~ 0.25μm | Modified LOCOS |
| ≤0.18μm | STI |
| ≤65nm | Advanced STI（如氧化物 / 氮化物复合隔离） |
五、总结
| 对比维度 | LOCOS | STI |
|---|---|---|
| 集成密度 | 低 | 高 |
| 鸟嘴效应 | 明显 | 无 |
| 隔离精度 | 差 | 高 |
| 热预算 | 高 | 低 |
| 工艺兼容性 | 差 | 强 |
| 表面形貌控制 | 差 | 好（可抛光） |
因此，随着工艺节点不断演进，STI 凭借其优异的尺寸缩放能力、电气性能和工艺兼容性，逐渐取代了 LOCOS，成为现代 CMOS 器件中最广泛使用的隔离技术。
